可预置定时器原理
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- 提问者网友:椧運幽默
- 2021-10-04 12:55
可预置定时器原理
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- 二级知识专家网友:舊物识亽
- 2021-10-04 13:25
555制造的数字式可预置定时器是一个采用数字电路进行定时预置、由声响作定时提醒的可预置定时器,最长定时时间为30 分钟,分6 挡预置,每挡间隔时间为5 分钟,可以用作家庭中的定时提醒装置,电路组成如图2-97 所示。
电路工作原理分析 本电路由定时时基脉冲发生器、数字式分频器、定时预置电路和制门电路组成。IC3 与Rl 、R2 、Cl 及VDl 、VD2 组长一个超低频的脉冲振荡器,振荡周期设计为5分钟。
十进制计数/分频器CD40l7 组成时基分频电路,将时基脉冲振荡器输入的时基脉冲边行分频,以取得所需要的定时时间。CD40l7 有10 个输出端,本电路只用其中的7 个。接通电源后, IC2 的QO 首先输出高电平,当第一个时基脉冲输入后,Ql 输出高电平。此后,第每当输入一个时基脉冲, lC2 的输出前移一位,定时时间增加5 分钟,直至Q6 输出高电平为止。
ICl 组成于动式数字调整预置电路,当按动预置按钮SBl 一次后,就有一个计数脉冲输人计数器ICI,它的输出端就前移一位,最大移位数为6 位,每一挡位为5 分钟,最长预置时间为30 分钟。
电路中的二极管组成控制门电路,其中VDlO~VD16 组-成预置电路的控制门, VD20~VD26 组成时基分频输出的控制门, VD3l~VD36 组成提示音响信号输出的控制门。
接通电源后,电路进入等待状态。这时, ICl , IC2 的QO 均输、出高电平, VDlO 与VD20 均处于反偏截止状态。电源经R20→RIO→LE[刀,使LEDO 发光。这时如果预置电路未进行预置,则ICl 的Ql~Q6 均输出低电平, VDll~VD16 均处于导通状态。与此同时,时基脉冲振荡器开始工作并以5 分钟的时间间隔输出时基脉冲,时基分频电路IC2 的输出端Ql~Q6 依次输出高电平。
VD31~VD36 组成提醒信号输出控制的或门电路,在定时器未进行预置时,由于ICl的Ql~Q6 均为低电平, VDll~VD16 均处于导通状态。这时IC2 的输出端Ql~Q6 不论是否输出高电平,均不能使VD3l~VD36 中的任何一只二极管导通。因此, IC2 输出端的任何一路高电平输出均不能输出提示信号。
当对预置电路进行定时预置后,例如:将预置时间预置为20 分钟后,这时ICl 的Q4输出高电平, VD14 反偏截止; QO~Q3 及Q5 , Q6 均为低电平, VD11~VD16 处于导通状态。这时,在分频电路IC2 的输出端中,当它的Q4 输出高电平时, VD24被反偏而截止,与ICl 的输出端Q4 和IC2 的Q4 连接在同一接点的VD34 导通,电游、经R24 通过VD24 发出提示信号,完成定时提醒过程。
本电路可以通过改变Rl 、R2 或Cl 的数值,改变时基脉冲的长度,从而改变定时时间。也可以将ICl 、IC2 的10 个输出端全部利用并增加相应的隔离二极管,扩大定时电路的调节范围。
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本文地址:555制造的数字式可预置定时器
电路工作原理分析 本电路由定时时基脉冲发生器、数字式分频器、定时预置电路和制门电路组成。IC3 与Rl 、R2 、Cl 及VDl 、VD2 组长一个超低频的脉冲振荡器,振荡周期设计为5分钟。
十进制计数/分频器CD40l7 组成时基分频电路,将时基脉冲振荡器输入的时基脉冲边行分频,以取得所需要的定时时间。CD40l7 有10 个输出端,本电路只用其中的7 个。接通电源后, IC2 的QO 首先输出高电平,当第一个时基脉冲输入后,Ql 输出高电平。此后,第每当输入一个时基脉冲, lC2 的输出前移一位,定时时间增加5 分钟,直至Q6 输出高电平为止。
ICl 组成于动式数字调整预置电路,当按动预置按钮SBl 一次后,就有一个计数脉冲输人计数器ICI,它的输出端就前移一位,最大移位数为6 位,每一挡位为5 分钟,最长预置时间为30 分钟。
电路中的二极管组成控制门电路,其中VDlO~VD16 组-成预置电路的控制门, VD20~VD26 组成时基分频输出的控制门, VD3l~VD36 组成提示音响信号输出的控制门。
接通电源后,电路进入等待状态。这时, ICl , IC2 的QO 均输、出高电平, VDlO 与VD20 均处于反偏截止状态。电源经R20→RIO→LE[刀,使LEDO 发光。这时如果预置电路未进行预置,则ICl 的Ql~Q6 均输出低电平, VDll~VD16 均处于导通状态。与此同时,时基脉冲振荡器开始工作并以5 分钟的时间间隔输出时基脉冲,时基分频电路IC2 的输出端Ql~Q6 依次输出高电平。
VD31~VD36 组成提醒信号输出控制的或门电路,在定时器未进行预置时,由于ICl的Ql~Q6 均为低电平, VDll~VD16 均处于导通状态。这时IC2 的输出端Ql~Q6 不论是否输出高电平,均不能使VD3l~VD36 中的任何一只二极管导通。因此, IC2 输出端的任何一路高电平输出均不能输出提示信号。
当对预置电路进行定时预置后,例如:将预置时间预置为20 分钟后,这时ICl 的Q4输出高电平, VD14 反偏截止; QO~Q3 及Q5 , Q6 均为低电平, VD11~VD16 处于导通状态。这时,在分频电路IC2 的输出端中,当它的Q4 输出高电平时, VD24被反偏而截止,与ICl 的输出端Q4 和IC2 的Q4 连接在同一接点的VD34 导通,电游、经R24 通过VD24 发出提示信号,完成定时提醒过程。
本电路可以通过改变Rl 、R2 或Cl 的数值,改变时基脉冲的长度,从而改变定时时间。也可以将ICl 、IC2 的10 个输出端全部利用并增加相应的隔离二极管,扩大定时电路的调节范围。
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- 1楼网友:雾月
- 2021-10-04 14:21
延时定时器电路由时钟振荡器、可预置计数器、控制器组成。预置好计数值,计数器对时钟脉冲计数,定时时间到,输出控制脉冲,触发控制器执行任务。
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