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FPGA验证完后做ASIC,新手求指导需要注意什么?

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解决时间 2021-01-10 07:24
FPGA验证完后做ASIC,新手求指导需要注意什么?
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补充下,若FGPA verification没问题则说明function没问题.剩下的就是ASIC flow的问题了.timing constraint, synthesis, scan, PR, STA, formal check 查看原帖>>
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design中用到的所有analog block,包括memory, PLL, PAD等.在转ASIC时,要仔细检查这些analog block的性能,function,连接关系,接口timing 查看原帖>>
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