如何使用Verilog编写二倍率采样
答案:1 悬赏:30
解决时间 2021-01-17 11:15
- 提问者网友：星軌
- 2021-01-16 22:39
如何使用Verilog编写二倍率采样
最佳答案
- 二级知识专家网友：老鼠爱大米
- 2021-01-16 23:25
二分频？
always@(posedge clk or negedge rst_b)
begin
if(!rst_b)
clk_div_2<= 0;
else
clk_div_2<=!clk_div_2;
end
always@(posedge clk or negedge rst_b)
begin
if(!rst_b)
clk_div_2<= 0;
else
clk_div_2<=!clk_div_2;
end
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